光刻技術是現代集成電路設計上一個比較大的瓶頸。現cpu使用的45nm、32nm工藝都是由193nm液浸式光刻系統來實現的，但是因受到波長的影響還在這個技術上有所突破是十分困難的，但是如采用EUV光刻技術就會很好的解決此問題，很可能會使該領域帶來一次飛躍。但是涉及到生產成本問題，由于193納米光刻是當前能力**強且**成熟的技術，能夠滿足精確度和成本要求，所以其工藝的延伸性非常強，很難被取代。因而在2011年國際固態電路會議(ISSCC2011)上也提到，在光刻技術方面，22/20nm節點主要幾家芯片廠商也將繼續使用基于193nm液浸式光刻系統的雙重成像（doublepatterning）技術。 [2]光刻系統主要由荷蘭ASML、日本Nikon和Canon壟斷。張家港購買光刻系統按需定制
其主要成像原理是光波波長為10～14nm的極端遠紫外光波經過周期性多層膜反射鏡投射到反射式掩模版上，通過反射式掩模版反射出的極紫外光波再通過由多面反射鏡組成的縮小投影系統，將反射式掩模版上的集成電路幾何圖形投影成像到硅片表面的光刻膠中，形成集成電路制造所需要的光刻圖形。目 前EUV技 術 采 用 的 曝 光 波 長 為13．5nm，由于其具有如此短的波長，所有光刻中不需要再使用光學鄰近效應校正（OPC）技術，因而它可以把光刻技術擴展到32nm以下技術節點。2009年9月Intel*** 次 向 世 人 展 示 了22 nm工藝晶圓，稱繼續使用193nm浸沒式光刻技術，并規 劃 與EUV及EBL曝 光 技 術 相 配 合，使193nm浸沒式光刻技術延伸到15和11nm工藝節點。 [3]虎丘區耐用光刻系統批量定制當前先進的EUV光刻系統已實現2nm制程芯片量，應用于微納器件加工、芯片制造等領域。
涂底方法：a、氣相成底膜的熱板涂底。HMDS蒸氣淀積，200～250C,30秒鐘；優點：涂底均勻、避免顆粒污染；b、旋轉涂底。缺點：顆粒污染、涂底不均勻、HMDS用量大。目的：使表面具有疏水性，增強基底表面與光刻膠的黏附性旋轉涂膠方法：a、靜態涂膠（Static）。硅片靜止時，滴膠、加速旋轉、甩膠、揮發溶劑（原光刻膠的溶劑約占65～85%,旋涂后約占10～20%）；b、動態（Dynamic）。低速旋轉（500rpm_rotation per minute）、滴膠、加速旋轉（3000rpm）、甩膠、揮發溶劑。
在曝光過程中，需要對不同的參數和可能缺陷進行跟蹤和控制，會用到檢測控制芯片/控片（Monitor Chip）。根據不同的檢測控制對象，可以分為以下幾種：a、顆粒控片（Particle MC）：用于芯片上微小顆粒的監控，使用前其顆粒數應小于10顆；b、卡盤顆粒控片（Chuck Particle MC）：測試光刻機上的卡盤平坦度的**芯片，其平坦度要求非常高；c、焦距控片（Focus MC）：作為光刻機監控焦距監控；d、關鍵尺寸控片（Critical Dimension MC）：用于光刻區關鍵尺寸穩定性的監控；低速旋轉（500rpm_rotation per minute）、滴膠、加速旋轉（3000rpm）、甩膠、揮發溶劑。
所有實際電子束曝光、顯影后圖形的邊緣要往外擴展，這就是所謂的“電子束鄰近效應。同時，半導體基片上如果有絕緣的介質膜，電子通過它時也會產生一定量的電荷積累，這些積累的電荷同樣會排斥后續曝光的電子，產生偏移，而不導電的絕緣體（如玻璃片）肯定不能采用電子束曝光。還有空間交變磁場、實驗室溫度變化等都會引起電子束曝光產生“漂移”現象。因此，即使擁有2nm電子束斑的曝 光 系統，要曝光出50nm以下的圖形結構也不容易。麻省理工學院（MIT）已經采用的電子束光刻技術分辨率將推進到9nm。電子束直寫光刻可以不需要目的：使表面具有疏水性，增強基底表面與光刻膠的黏附性。工業園區省電光刻系統規格尺寸
無掩模激光直寫系統利用激光直接在基材上成像，適用于柔性電子器件制造等領域 [5]。張家港購買光刻系統按需定制
c、水坑（旋覆浸沒）式顯影（Puddle Development）。噴覆足夠（不能太多，**小化背面濕度）的顯影液到硅片表面，并形成水坑形狀（顯影液的流動保持較低，以減少邊緣顯影速率的變化）。硅片固定或慢慢旋轉。一般采用多次旋覆顯影液：***次涂覆、保持10～30秒、去除；第二次涂覆、保持、去除。然后用去離子水沖洗（去除硅片兩面的所有化學品）并旋轉甩干。優點：顯影液用量少；硅片顯影均勻；**小化了溫度梯度。顯影液：a、正性光刻膠的顯影液。正膠的顯影液位堿性水溶液。KOH和NaOH因為會帶來可動離子污染（MIC，Movable Ion Contamination），所以在IC制造中一般不用。張家港購買光刻系統按需定制
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