使用單晶硅晶圓（或III-V族，如砷化鎵）用作基層。然后使用微影、擴散、CMP等技術制成MOSFET或BJT等組件，然后利用微影、薄膜、和CMP技術制成導線，如此便完成芯片制作。因產品性能需求及成本考量，導線可分為鋁制程和銅制程。IC由很多重疊的層組成，每層由圖像技術定義，通常用不同的顏色表示。一些層標明在哪里不同的摻雜劑擴散進基層（成為擴散層），一些定義哪里額外的離子灌輸（灌輸層），一些定義導體（多晶硅或金屬層），一些定義傳導層之間的連接（過孔或接觸層）。所有的組件由這些層的特定組合構成。任何瞬間的短路都容易損壞集成電路，尤其在測試扁平型封裝的CMOS集成電路時更要加倍小心。江陰常見集成電路生產廠家

——這是集成電路的布局，模擬電路和數字電路分開，處理小信號的敏感電路與翻轉頻繁的控制邏輯分開，電源單獨放在一角。每層樓的房間布局不一樣，走廊也不一樣，有回字形的、工字形的、幾字形的——這是集成電路器件設計，低噪聲電路中可以用折疊形狀或“叉指”結構的晶體管來減小結面積和柵電阻。各樓層直接有高速電梯可達，為了效率和功能隔離，還可能有多部電梯，每部電梯能到的樓層不同——這是集成電路的布線，電源線、地線單獨走線，負載大的線也寬；時鐘與信號分開；每層之間布線垂直避免干擾；CPU與存儲之間的高速總線，相當于電梯，各層之間的通孔相當于電梯間……無錫標準集成電路銷售方法集成電路按制作工藝可分為半導體集成電路和膜集成電路。

球形觸點陣列，表面貼裝型封裝之一。在印刷基板的背面按陣列方式制作出球形凸點用以代替引腳，在印刷基板的正面裝配LSI芯片，然后用模壓樹脂或灌封方法進行密封。也稱為凸點陣列載體（PAC）。引腳可超過200，是多引腳LSI 用的一種封裝。封裝本體也可做得比QFP（四側引腳扁平封裝）小。例如，引腳中心距為1.5mm的360引腳BGA*為31mm見方；而引腳中心距為0.5mm的304 引腳QFP為40mm見方。而且BGA不用擔心QFP那樣的引腳變形問題（見有圖所示）。

16、FQFP（fine pitch quad flat package）小引腳中心距QFP。通常指引腳中心距小于0.65mm的QFP（見QFP）。部分導導體廠家采用此名稱。17、CPAC（globe top pad array carrier）美國Motorola公司對BGA的別稱（見BGA）。18、CQFP（quad fiat package with guard ring）帶保護環的四側引腳扁平封裝。塑料QFP之一，引腳用樹脂保護環掩蔽，以防止彎曲變形。在把LSI組裝在印刷基板上之前，從保護環處切斷引腳并使其成為海鷗翼狀（L形狀）。這種封裝在美國Motorola公司已批量生產。引腳中心距0.5mm，引腳數**多為208左右。例如半導體收音機的音頻信號、錄放機的磁帶信號等），其輸入信號和輸出信號成比例關系。

42、QFJ（quad flat J-leaded package）四側J形引腳扁平封裝。表面貼裝封裝之一。引腳從封裝四個側面引出，向下呈J字形。是日本電子機械工業會規定的名稱。引腳中心距1.27mm。材料有塑料和陶瓷兩種。塑料QFJ多數情況稱為PLCC（見PLCC），用于微機、門陳列、DRAM、ASSP、OTP 等電路。引腳數從18至84。陶瓷QFJ也稱為CLCC、JLCC（見CLCC）。帶窗口的封裝用于紫外線擦除型EPROM以及帶有EPROM的微機芯片電路。引腳數從32至84。43、QFN（quad flat non-leaded package）集成電路四側無引腳扁平封裝。表面貼裝型封裝之一。90年代后期多稱為LCC。QFN是日本電子機械工業會規定的名稱。封裝四側配置有電極觸點，由于無引腳，貼裝占有面積比QFP小，高度比QFP低。前述將電路制造在半導體芯片表面上的集成電路又稱薄膜（thin-film）集成電路。無錫標準集成電路銷售方法

雙側引腳帶載封裝。TCP（帶載封裝）之一。江陰常見集成電路生產廠家

7、測試儀表內阻要大測量集成電路引腳直流電壓時，應選用表頭內阻大于20KΩ/V的萬用表，否則對某些引腳電壓會有較大的測量誤差。8、要注意功率集成電路的散熱功率集成電路應散熱良好，不允許不帶散熱器而處于大功率的狀態下工作。9、引線要合理如需要加接**元件代替集成電路內部已損壞部分，應選用小型元器件，且接線要合理以免造成不必要的寄生耦合，尤其是要處理好音頻功放集成電路和前置放大電路之間的接地端。例如：肖特基4輸入與非門CT54S20MDC—符合國家標準T—TTL電路54S20—肖特基雙4輸入與非門M—‐55~125℃D—多層陶瓷雙列直插封裝1、BGA（ball grid array）江陰常見集成電路生產廠家

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